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J-BERT N4903B 高性能串行 BERT 為嵌入式時鐘設(shè)備和正向時鐘設(shè)備提供*完整的抖動容限測試。
當(dāng)研發(fā)和驗證團(tuán)隊需要對包含 7 Gb/s 或 12.5 Gb/s 串行 I/O 端口的芯片和收發(fā)信機(jī)模塊進(jìn)行表征和強(qiáng)化測試時,它是*理想的選擇。它可以表征接收機(jī)的抖動容限,并可檢查與當(dāng)前*流行的串行總線標(biāo)準(zhǔn)的一致性,例如:
使用具有極低抖動和極短跳變時間的碼型發(fā)生器生成干凈信號,實現(xiàn)**表征。經(jīng)過校準(zhǔn)的內(nèi)置抖動源使您可以對接收機(jī)進(jìn)行**的抖動容限測試。
J-BERT N4903B 是為與串行總線標(biāo)準(zhǔn)實現(xiàn)*佳匹配而設(shè)計的,具有差分 I/O、在大多數(shù)輸出上可變的電壓電平、內(nèi)置的抖動和 ISI 功能、碼型序列發(fā)生器、參考時鐘輸出、可調(diào)諧 CDR、碼型捕獲和比特恢復(fù)模式,可對無時鐘和不確定的碼型進(jìn)行分析,因此可以顯著簡化測試設(shè)置。
使用 J-BERT 的自動抖動容限測試和快速總體抖動測量,可以更快地執(zhí)行測試。
J-BERT N4903B 是一項長期投資,它可以根據(jù)當(dāng)前的測試和預(yù)算要求進(jìn)行配置,還可以從 N4903A 進(jìn)行升級,并在以后測試需求變化時對所有的選件和全速器件進(jìn)行改型。
PCIe 是 PCI-SIG 的商標(biāo),PCI Express 是 PCI-SIG 的注冊商標(biāo)
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